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sram 2

RTL - SRAM (`ifdef를 이용한 FPGA, ASIC 코드 분리)

https://insoobaik.tistory.com/660 SRAM 구조 및 동작 원리보호되어 있는 글입니다. 내용을 보시려면 비밀번호를 입력하세요.insoobaik.tistory.comSRAM에 대한 내용은 위 글을 참고한다.■ SRAM SRAM은 기본적으로 clock, cs, we, ad, din, dout Pin을 가지게 된다. - clock : 동기화를 위해 사용된다.- cs : Chip Select로 해당 칩을 동작 시킬것인지 정하게 된다. High 신호에 동작하는 경우, cs가 1(High)일 때 만 Read, Write 행위가 가능하다.- we : Write Enable로 해당 메모리에 Read할 것인지 Write할 것인지 정하게 된다 (ex we 신호가 0일 경우 Read, we 신호가 ..

SRAM 구조 및 동작 원리

SRAM (Static Random Access Memor) 전원이 공급되는 한 데이터를 지속적으로 유지할 수 있는 고속 메모리에 해당한다. DRAM과 달리 주기적으로 데이터를 Refresh할 필요가 없다. SRAM은 총 6개의 트랜지스터로 구성된다.  두 개의 인버터가 교차 연결되어 래치 구조로 데이터를 저장한다. Word Line과 Bit Line과 6개의 트랜지스터를 통해 데이터를 읽고 쓸 수 있다.SRAM의 구조SRAM은 위와 같이 6개의 트랜지스터와 Bit Line, Word Line으로 구성되어 있다. 중앙 4개의 트랜지스터는 위 그림과 같이 2개 인버터가 교차해 있는 래치 구조로 표현할 수 있다.Word Line 1. 셸 선택SRAM 셸 배열에서 특정 행을 선택하는 신호선이다.읽기 또는 쓰기..

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